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Diagramma degli stati primitivo (Mealy) SE,P Tabella degli stati primitiva / Ricerca stati compatibili 00011110 AA,0-,- B,0 BC,--,-G,0B,0 CC,1D,1-,-

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2 Diagramma degli stati primitivo (Mealy) SE,P

3 Tabella degli stati primitiva / Ricerca stati compatibili AA,0-,- B,0 BC,--,-G,0B,0 CC,1D,1-,- DE,1D,1-,- EE,1-,- F,1 FC,1-,-G,-F,1 G-,-H,0G,0-,- HA,0H,0-,- BAC CX-- DXCE EXX-- FXX CE G-- XX H XXXXX ABCDEFG SE Classi massime di compatibilità che soddisfano copertura e chiusura: [A,G,H] => α [B] => β [C,D,E,F] => γ

4 Assegnazione. Tabella transizioni ridotta AA,0-,- B,0 BC,--,-G,0B,0 CC,1D,1-,- DE,1D,1-,- EE,1-,- F,1 FC,1-,-G,-F,1 G-,-H,0G,0-,- HA,0H,0-,- SE α α,0 β,0 β γ,--,- α,0 β,0 γ γ,1 α,- γ,1 SE y1 y ,0 01,0 0111,---,-00,001,0 1111,1 00,-11,1 10--,- SE È presente una corsa critica perché cè un cambiamento contemporaneo di 2 variabili di stato y1 y ,0 01,0 0111,---,-00,001,0 1111,1 10,-11,1 10--,- 00,---,- SE Inserita una transizione per permettere il cambiamento di una variabile di stato alla volta e assicurare un corretto funzionamento del progetto y 1 = !Sy 2 + y 1 y 2 y 2 = S!E + !Sy 2 P = y1

5 Schematico Xilinx y 1 = !Sy 2 + y 1 y 2 y 2 = S!E + !Sy 2 P = y1

6 Schematico Xilinx – Circuito a NOR Ho realizzato lo stesso circuito utilizzando soltanto porte NOR (porta UNIVERSALE come NAND): dopo aver convertito ogni porta logica, ho semplificato al meglio il circuito. Ho anche verificato che, in questo caso, il circuito con soli NOR è «più conveniente» di un circuito con soli NAND. Questa conversione è molto utile perché si può risparmiare sul numero di circuiti integrati, dato che ogni circuito integrato è composto da sole porte dello stesso tipo. È in ogni caso molto utile perché non ho bisogno di avere più tipi di porte: posso costruire il mio circuito utilizzando «un solo tipo di mattone».

7 Simulazione Post-Route La simulazione, tramite Testbench VHDL, prevede che vengano dati «10 pesci in ingresso» al sistema di dimensioni grandi o piccole, attraverso un algoritmo di generazione pseudo-casuale (nel test VHDL viene utilizzata la libreria «ieee.math_real»). Si può vedere dal grafico che, non appena il circuito è in grado di stabilire la dimensione del pesce che sta passando sul nastro trasportatore (e questo avviene subito dopo che la configurazione passa da SE = «10» allo stato successivo), questo commuta il prima possibile, e ragionevolmente, lo stato di P (il segnale che gestisce il deviatore pilotato). Come si può osservare, al passaggio di un pesce piccolo (SE = «10» SE = «00») luscita commuta in P = 1, altrimenti, al passaggio di un pesce grande (di lunghezza >= L; SE = «10» SE = «11») luscita P va a 0.


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