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A.S.E.18.1 ARCHITETTURA DEI SISTEMI ELETTRONICI LEZIONE N° 18 Reti sequenzialiReti sequenziali –concetto di memoria –anelli di reazione EsempioEsempio.

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1 A.S.E.18.1 ARCHITETTURA DEI SISTEMI ELETTRONICI LEZIONE N° 18 Reti sequenzialiReti sequenziali –concetto di memoria –anelli di reazione EsempioEsempio –Flip - Flop S - R

2 A.S.E.18.2 Richiami Reti combinatorieReti combinatorie –Porte elementari –Porte NAND e NOR Reti sequenzialiReti sequenziali –Concetto di cicli Sintesi delle reti combinatorieSintesi delle reti combinatorie AleeAlee

3 A.S.E.18.3 Definizioni Reti COMBINATORIEReti COMBINATORIE In qualunque istante le uscite sono funzione del valore che gli ingressi hanno in quell’istanteIn qualunque istante le uscite sono funzione del valore che gli ingressi hanno in quell’istante Il comportamento (uscite in funzione degli ingressi) è descritto da una tabellaIl comportamento (uscite in funzione degli ingressi) è descritto da una tabella Reti SEQUENZIALIReti SEQUENZIALI In un determinato istante le uscite sono funzione del valore che gli ingressi hanno in quell’istante e i valori che hanno assunto precedentementeIn un determinato istante le uscite sono funzione del valore che gli ingressi hanno in quell’istante e i valori che hanno assunto precedentemente La descrizione è più complessaLa descrizione è più complessa Stati InterniStati Interni Reti dotate di MEMORIAReti dotate di MEMORIA

4 A.S.E.18.4 Memoria delle reti sequenziali OsservazioneOsservazione –In ogni istante la rete deve “ricordarsi” il valore che alcune variabili logiche avevano precedentemente –la memorizzazione viene fatta da “opportuni” collegamenti interni alla rete CicliCicli Anelli di reazioneAnelli di reazione AnelliAnelli Attenzione !!Attenzione !! –l’assenza di cicli comporta => rete combinatoria –la presenza di cicli non garantisce =>reti sequenziali –(reazione positiva)

5 A.S.E.18.5 Modello 1 di rete sequenziale R R’ X1X1 XnXn z1z1 zmzm s1s1 sksk s’ 1 s’ k tt La rete R’ è priva di anelli, ovvero è una rete combinatoria

6 A.S.E.18.6 Macchina di Mealy1 Le uscite sono funzioni delle variabili di stato e degli ingressiLe uscite sono funzioni delle variabili di stato e degli ingressi R R’ X1X1 XnXn z1z1 s p1 s Pk s n1 s nk a1a1 anan a n+1 a n+k z1z1 zmzm z m+1 z m+k zmzm Memoria

7 A.S.E.18.7 Macchina di MOORE1 Le variabili d’uscita, in un determinato istante, sono funzione del sole variabili di statoLe variabili d’uscita, in un determinato istante, sono funzione del sole variabili di stato R CN 1 X1X1 XnXn z1z1 zWzW s1s1 sksk s’ k s’ 1 a1a1 anan a n+1 a n+k z1z1 zmzm z m+1 zkzk CN 2 Memoria

8 A.S.E.18.8 Instabilità Segnale di CLOCKSegnale di CLOCK La memoria cambia le proprie usciti in corrispondenza del fronte di discesa (salita) del CLOCKLa memoria cambia le proprie usciti in corrispondenza del fronte di discesa (salita) del CLOCK T V

9 A.S.E.18.9 Macchina di Mealy2 Le uscite sono funzioni delle variabili di stato e degli ingressiLe uscite sono funzioni delle variabili di stato e degli ingressi R R’ X1X1 XnXn z1z1 s p1 s Pk s n1 s nk a1a1 anan a n+1 a n+k z1z1 zmzm z m+1 z m+k zmzm Ck

10 A.S.E Macchina di MOORE2 Le variabili d’uscita, in un determinato istante, sono funzione del sole variabili di statoLe variabili d’uscita, in un determinato istante, sono funzione del sole variabili di stato R CN 1 X1X1 XnXn z1z1 zWzW s1s1 sksk s’ k s’ 1 a1a1 anan a n+1 a n+k z1z1 zmzm z m+1 zkzk CN 2 Ck

11 A.S.E Flip – Flop R-S R S Q QQ SRQ QQQQ 00Q QQQQ S R Q QQ t

12 A.S.E Conclusioni Reti SequenzialiReti Sequenziali Flip Flop R-SFlip Flop R-S


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